trab2.circ

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This file is intended to be loaded by Logisim-evolution (https://github.com/reds-heig/logisim-evolution).
<lib desc="#Wiring" name="0">
    <tool name="Splitter">
      <a name="fanout" val="32"/>
      <a name="incoming" val="32"/>
      <a name="appear" val="right"/>
    </tool>
  </lib>
  <lib desc="#Gates" name="1">
    <tool name="AND Gate">
      <a name="width" val="32"/>
    </tool>
    <tool name="OR Gate">
      <a name="inputs" val="32"/>
    </tool>
    <tool name="NOR Gate">
      <a name="width" val="32"/>
    </tool>
  </lib>
  <lib desc="#Plexers" name="2">
    <tool name="Multiplexer">
      <a name="select" val="3"/>
      <a name="width" val="32"/>
      <a name="enable" val="false"/>
    </tool>
    <tool name="Demultiplexer">
      <a name="select" val="5"/>
      <a name="enable" val="false"/>
    </tool>
  </lib>
  <lib desc="#Arithmetic" name="3">
    <tool name="Adder">
      <a name="width" val="32"/>
    </tool>
  </lib>
  <lib desc="#Memory" name="4">
    <tool name="Register">
      <a name="width" val="32"/>
    </tool>
    <tool name="ROM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
  </lib>
  <lib desc="#I/O" name="5"/>
  <lib desc="#HDL-IP" name="6">
    <tool name="VHDL Entity">
      <a name="content">--------------------------------------------------------------------------------
-- HEIG-VD, institute REDS, 1400 Yverdon-les-Bains
-- Project :
-- File    :
-- Autor   :
-- Date    :
--
--------------------------------------------------------------------------------
-- Description :
--
--------------------------------------------------------------------------------

library ieee;
  use ieee.std_logic_1164.all;
  --use ieee.numeric_std.all;

entity VHDL_Component is
  port(
  ------------------------------------------------------------------------------
  --Insert input ports below
    horloge_i  : in  std_logic;                    -- input bit example
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example
  ------------------------------------------------------------------------------
  --Insert output ports below
    max_o      : out std_logic;                    -- output bit example
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example
    );
end VHDL_Component;

--------------------------------------------------------------------------------
--Complete your VHDL description below
architecture type_architecture of VHDL_Component is


begin


end type_architecture;
</a>
    </tool>
  </lib>
  <lib desc="#TCL" name="7">
    <tool name="TclGeneric">
      <a name="content">library ieee;
use ieee.std_logic_1164.all;

entity TCL_Generic is
  port(
    --Insert input ports below
    horloge_i  : in  std_logic;                    -- input bit example
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example

	  --Insert output ports below
    max_o      : out std_logic;                    -- output bit example
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example
  );
end TCL_Generic;
</a>
    </tool>
  </lib>
  <lib desc="#Base" name="8">
    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <lib desc="#BFH-Praktika" name="9"/>
  <main name="main"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
    <a name="tickmain" val="half_period"/>
  </options>
  <mappings>
    <tool lib="8" map="Button2" name="Menu Tool"/>
    <tool lib="8" map="Button3" name="Menu Tool"/>
    <tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="8" name="Poke Tool"/>
    <tool lib="8" name="Edit Tool"/>
    <tool lib="8" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin"/>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
  </toolbar>
  <circuit name="main">
    <a name="circuit" val="main"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif bold 16"/>
    <a name="circuitnamedbox" val="true"/>
    <a name="circuitvhdlpath" val=""/>
    <wire from="(1320,520)" to="(1320,700)"/>
    <wire from="(660,620)" to="(780,620)"/>
    <wire from="(660,600)" to="(780,600)"/>
    <wire from="(1080,560)" to="(1120,560)"/>
    <wire from="(930,520)" to="(1120,520)"/>
    <wire from="(930,540)" to="(1120,540)"/>
    <wire from="(1320,520)" to="(1410,520)"/>
    <wire from="(740,580)" to="(780,580)"/>
    <wire from="(740,580)" to="(740,700)"/>
    <wire from="(1260,540)" to="(1350,540)"/>
    <wire from="(740,700)" to="(1320,700)"/>
    <wire from="(1260,520)" to="(1320,520)"/>
    <wire from="(640,520)" to="(780,520)"/>
    <wire from="(640,540)" to="(780,540)"/>
    <wire from="(640,560)" to="(780,560)"/>
    <comp loc="(930,520)" name="Registers"/>
    <comp loc="(1260,520)" name="ALU"/>
    <comp lib="0" loc="(1350,540)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="0" loc="(1410,520)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="32"/>
      <a name="labelloc" val="east"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(1080,560)" name="Pin">
      <a name="width" val="3"/>
    </comp>
    <comp lib="0" loc="(660,620)" name="Pin"/>
    <comp lib="0" loc="(660,600)" name="Pin"/>
    <comp lib="0" loc="(640,520)" name="Pin">
      <a name="width" val="5"/>
    </comp>
    <comp lib="0" loc="(640,540)" name="Pin">
      <a name="width" val="5"/>
    </comp>
    <comp lib="0" loc="(640,560)" name="Pin">
      <a name="width" val="5"/>
    </comp>
  </circuit>
  <circuit name="Registers">
    <a name="circuit" val="Registers"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif bold 16"/>
    <a name="circuitnamedbox" val="true"/>
    <a name="circuitvhdlpath" val=""/>
    <wire from="(1690,820)" to="(1730,820)"/>
    <wire from="(2000,1130)" to="(2040,1130)"/>
    <wire from="(2710,410)" to="(2740,410)"/>
    <wire from="(1390,680)" to="(1430,680)"/>
    <wire from="(1870,1420)" to="(1870,1500)"/>
    <wire from="(1580,1480)" to="(1580,1620)"/>
    <wire from="(1070,770)" to="(1150,770)"/>
    <wire from="(690,1640)" to="(900,1640)"/>
    <wire from="(1260,430)" to="(2680,430)"/>
    <wire from="(690,1770)" to="(1030,1770)"/>
    <wire from="(2430,690)" to="(2740,690)"/>
    <wire from="(2000,910)" to="(2000,1020)"/>
    <wire from="(2570,550)" to="(2740,550)"/>
    <wire from="(2640,880)" to="(2740,880)"/>
    <wire from="(2430,690)" to="(2430,1090)"/>
    <wire from="(2510,610)" to="(2510,1010)"/>
    <wire from="(2500,1020)" to="(2740,1020)"/>
    <wire from="(2590,530)" to="(2590,930)"/>
    <wire from="(2670,450)" to="(2670,850)"/>
    <wire from="(690,1510)" to="(770,1510)"/>
    <wire from="(1070,1100)" to="(1070,1210)"/>
    <wire from="(1110,1140)" to="(1110,1250)"/>
    <wire from="(1210,380)" to="(2730,380)"/>
    <wire from="(2720,400)" to="(2740,400)"/>
    <wire from="(2580,540)" to="(2740,540)"/>
    <wire from="(1870,1420)" to="(2040,1420)"/>
    <wire from="(2650,870)" to="(2740,870)"/>
    <wire from="(930,1400)" to="(1570,1400)"/>
    <wire from="(940,1410)" to="(1580,1410)"/>
    <wire from="(950,1420)" to="(1590,1420)"/>
    <wire from="(960,1430)" to="(1600,1430)"/>
    <wire from="(970,1440)" to="(1610,1440)"/>
    <wire from="(980,1450)" to="(1620,1450)"/>
    <wire from="(990,1460)" to="(1630,1460)"/>
    <wire from="(1000,1470)" to="(1640,1470)"/>
    <wire from="(1510,480)" to="(1510,750)"/>
    <wire from="(1790,540)" to="(1790,670)"/>
    <wire from="(810,900)" to="(1150,900)"/>
    <wire from="(1290,1190)" to="(1430,1190)"/>
    <wire from="(2690,420)" to="(2690,430)"/>
    <wire from="(2810,290)" to="(2810,1130)"/>
    <wire from="(1520,490)" to="(2620,490)"/>
    <wire from="(1210,1210)" to="(1280,1210)"/>
    <wire from="(1900,1000)" to="(2040,1000)"/>
    <wire from="(1650,1000)" to="(1730,1000)"/>
    <wire from="(2530,580)" to="(2530,590)"/>
    <wire from="(2610,500)" to="(2610,510)"/>
    <wire from="(1210,380)" to="(1210,440)"/>
    <wire from="(2450,660)" to="(2450,670)"/>
    <wire from="(2440,680)" to="(2740,680)"/>
    <wire from="(2120,640)" to="(2120,980)"/>
    <wire from="(1690,1370)" to="(1690,1480)"/>
    <wire from="(690,1560)" to="(820,1560)"/>
    <wire from="(690,1690)" to="(950,1690)"/>
    <wire from="(1650,1330)" to="(1650,1440)"/>
    <wire from="(2100,1200)" to="(2140,1200)"/>
    <wire from="(1290,970)" to="(1290,1080)"/>
    <wire from="(1390,1230)" to="(1390,1340)"/>
    <wire from="(2510,1010)" to="(2740,1010)"/>
    <wire from="(1650,1600)" to="(1870,1600)"/>
    <wire from="(1640,1460)" to="(1730,1460)"/>
    <wire from="(2520,1000)" to="(2740,1000)"/>
    <wire from="(2000,910)" to="(2040,910)"/>
    <wire from="(1320,770)" to="(1430,770)"/>
    <wire from="(1110,1140)" to="(1150,1140)"/>
    <wire from="(2590,530)" to="(2740,530)"/>
    <wire from="(1330,1340)" to="(1390,1340)"/>
    <wire from="(2660,860)" to="(2740,860)"/>
    <wire from="(1830,580)" to="(2530,580)"/>
    <wire from="(2130,650)" to="(2130,1090)"/>
    <wire from="(2730,390)" to="(2740,390)"/>
    <wire from="(1070,550)" to="(1150,550)"/>
    <wire from="(1790,1440)" to="(1860,1440)"/>
    <wire from="(1520,490)" to="(1520,860)"/>
    <wire from="(2140,660)" to="(2450,660)"/>
    <wire from="(1490,1300)" to="(1560,1300)"/>
    <wire from="(1210,770)" to="(1240,770)"/>
    <wire from="(1580,800)" to="(1730,800)"/>
    <wire from="(1870,1200)" to="(1870,1310)"/>
    <wire from="(2460,660)" to="(2460,1060)"/>
    <wire from="(1040,1550)" to="(1040,1780)"/>
    <wire from="(2540,580)" to="(2540,980)"/>
    <wire from="(1010,1520)" to="(1010,1750)"/>
    <wire from="(1020,1530)" to="(1020,1760)"/>
    <wire from="(1030,1540)" to="(1030,1770)"/>
    <wire from="(1050,1560)" to="(1050,1790)"/>
    <wire from="(1060,1570)" to="(1060,1800)"/>
    <wire from="(2620,500)" to="(2620,900)"/>
    <wire from="(2700,420)" to="(2700,820)"/>
    <wire from="(2450,670)" to="(2740,670)"/>
    <wire from="(1800,550)" to="(1800,780)"/>
    <wire from="(1070,880)" to="(1070,990)"/>
    <wire from="(1110,920)" to="(1110,1030)"/>
    <wire from="(690,1740)" to="(1000,1740)"/>
    <wire from="(1690,1370)" to="(1730,1370)"/>
    <wire from="(690,1610)" to="(870,1610)"/>
    <wire from="(2530,990)" to="(2740,990)"/>
    <wire from="(1580,1480)" to="(1690,1480)"/>
    <wire from="(1870,1200)" to="(2040,1200)"/>
    <wire from="(1390,1230)" to="(1430,1230)"/>
    <wire from="(2460,660)" to="(2740,660)"/>
    <wire from="(2670,850)" to="(2740,850)"/>
    <wire from="(2600,520)" to="(2740,520)"/>
    <wire from="(2780,550)" to="(2910,550)"/>
    <wire from="(1570,690)" to="(1570,1400)"/>
    <wire from="(1290,970)" to="(1430,970)"/>
    <wire from="(2640,470)" to="(2640,480)"/>
    <wire from="(2720,390)" to="(2720,400)"/>
    <wire from="(1590,910)" to="(1590,1420)"/>
    <wire from="(1650,780)" to="(1730,780)"/>
    <wire from="(2560,550)" to="(2560,560)"/>
    <wire from="(2480,630)" to="(2480,640)"/>
    <wire from="(2000,1460)" to="(2000,1570)"/>
    <wire from="(1220,390)" to="(1220,550)"/>
    <wire from="(1150,520)" to="(1180,520)"/>
    <wire from="(1490,860)" to="(1520,860)"/>
    <wire from="(1690,1150)" to="(1690,1260)"/>
    <wire from="(1070,1600)" to="(1290,1600)"/>
    <wire from="(1650,1110)" to="(1650,1220)"/>
    <wire from="(1950,1550)" to="(2040,1550)"/>
    <wire from="(1790,1000)" to="(1820,1000)"/>
    <wire from="(1580,800)" to="(1580,1410)"/>
    <wire from="(1390,1010)" to="(1390,1120)"/>
    <wire from="(1290,750)" to="(1290,860)"/>
    <wire from="(1530,500)" to="(1530,970)"/>
    <wire from="(1600,1020)" to="(1600,1430)"/>
    <wire from="(1630,1350)" to="(1730,1350)"/>
    <wire from="(1110,920)" to="(1150,920)"/>
    <wire from="(1010,1520)" to="(1880,1520)"/>
    <wire from="(1020,1530)" to="(1890,1530)"/>
    <wire from="(1030,1540)" to="(1900,1540)"/>
    <wire from="(1040,1550)" to="(1910,1550)"/>
    <wire from="(1050,1560)" to="(1920,1560)"/>
    <wire from="(1060,1570)" to="(1930,1570)"/>
    <wire from="(1810,560)" to="(1810,890)"/>
    <wire from="(1370,1320)" to="(1430,1320)"/>
    <wire from="(690,1660)" to="(920,1660)"/>
    <wire from="(690,1790)" to="(1050,1790)"/>
    <wire from="(690,1530)" to="(790,1530)"/>
    <wire from="(2470,650)" to="(2740,650)"/>
    <wire from="(2610,510)" to="(2740,510)"/>
    <wire from="(2100,1530)" to="(2170,1530)"/>
    <wire from="(1240,410)" to="(2700,410)"/>
    <wire from="(2540,980)" to="(2740,980)"/>
    <wire from="(1290,1290)" to="(1290,1600)"/>
    <wire from="(1550,520)" to="(2590,520)"/>
    <wire from="(800,790)" to="(1150,790)"/>
    <wire from="(1610,1130)" to="(1610,1440)"/>
    <wire from="(890,1360)" to="(1340,1360)"/>
    <wire from="(900,1370)" to="(1350,1370)"/>
    <wire from="(910,1380)" to="(1360,1380)"/>
    <wire from="(920,1390)" to="(1370,1390)"/>
    <wire from="(1870,980)" to="(1870,1090)"/>
    <wire from="(2490,630)" to="(2490,1030)"/>
    <wire from="(2570,550)" to="(2570,950)"/>
    <wire from="(1890,890)" to="(2040,890)"/>
    <wire from="(1430,610)" to="(1460,610)"/>
    <wire from="(2650,470)" to="(2650,870)"/>
    <wire from="(2800,200)" to="(2800,730)"/>
    <wire from="(2730,390)" to="(2730,790)"/>
    <wire from="(2140,660)" to="(2140,1200)"/>
    <wire from="(1300,550)" to="(1300,1300)"/>
    <wire from="(1070,660)" to="(1070,770)"/>
    <wire from="(1110,700)" to="(1110,810)"/>
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