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<project source="3.5.0" version="1.0">
This file is intended to be loaded by Logisim-evolution (https://github.com/reds-heig/logisim-evolution).
<lib desc="#Wiring" name="0">
<tool name="Splitter">
<a name="bit1" val="0"/>
<a name="fanout" val="1"/>
</tool>
<tool name="Pin">
<a name="appearance" val="NewPins"/>
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<tool name="Probe">
<a name="appearance" val="NewPins"/>
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<tool name="Constant">
<a name="facing" val="south"/>
<a name="value" val="0x0"/>
</tool>
</lib>
<lib desc="#Gates" name="1">
<tool name="PLA">
<a name="table" val=""/>
</tool>
</lib>
<lib desc="#Plexers" name="2">
<tool name="Multiplexer">
<a name="enable" val="false"/>
</tool>
<tool name="Demultiplexer">
<a name="enable" val="false"/>
</tool>
</lib>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4">
<tool name="D Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="T Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="J-K Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="S-R Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Register">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Counter">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Shift Register">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Random">
<a name="appearance" val="logisim_evolution"/>
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<tool name="RAM">
<a name="appearance" val="logisim_evolution"/>
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<tool name="ROM">
<a name="appearance" val="logisim_evolution"/>
<a name="contents">addr/data: 8 8
0
</a>
</tool>
</lib>
<lib desc="#I/O" name="5"/>
<lib desc="#TTL" name="6"/>
<lib desc="#TCL" name="7">
<tool name="TclGeneric">
<a name="content">library ieee;
use ieee.std_logic_1164.all;
entity TCL_Generic is
port(
--Insert input ports below
horloge_i : in std_logic; -- input bit example
val_i : in std_logic_vector(3 downto 0); -- input vector example
--Insert output ports below
max_o : out std_logic; -- output bit example
cpt_o : out std_logic_Vector(3 downto 0) -- output vector example
);
end TCL_Generic;
</a>
</tool>
</lib>
<lib desc="#Base" name="8">
<tool name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="text" val=""/>
<a name="valign" val="base"/>
</tool>
</lib>
<lib desc="#BFH-Praktika" name="9"/>
<lib desc="#Input/Output-Extra" name="10"/>
<lib desc="#Soc" name="11">
<tool name="Rv32im">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="Nios2">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocBus">
<a name="SocBusIdentifier" val="0x0000016FBEFD2F923344e8b5"/>
</tool>
<tool name="Socmem">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocPio">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocVga">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocJtagUart">
<a name="SocBusSelection" val=""/>
</tool>
</lib>
<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="8" map="Button2" name="Menu Tool"/>
<tool lib="8" map="Button3" name="Menu Tool"/>
<tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="8" name="Poke Tool"/>
<tool lib="8" name="Edit Tool"/>
<tool lib="8" name="Wiring Tool"/>
<tool lib="8" name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="text" val=""/>
<a name="valign" val="base"/>
</tool>
<sep/>
<tool lib="0" name="Pin">
<a name="appearance" val="NewPins"/>
</tool>
<tool lib="0" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="output" val="true"/>
</tool>
<sep/>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
<tool lib="1" name="XOR Gate"/>
<tool lib="1" name="NAND Gate"/>
<tool lib="1" name="NOR Gate"/>
<sep/>
<tool lib="4" name="D Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool lib="4" name="Register">
<a name="appearance" val="logisim_evolution"/>
</tool>
</toolbar>
<circuit name="main">
<a name="appearance" val="logisim_evolution"/>
<a name="circuit" val="main"/>
<a name="circuitnamedboxfixedsize" val="true"/>
<a name="circuitvhdlpath" val=""/>
<a name="clabel" val=""/>
<a name="clabelfont" val="SansSerif bold 16"/>
<a name="clabelup" val="east"/>
<comp lib="0" loc="(1100,210)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="label" val="SEL_OP"/>
<a name="output" val="true"/>
<a name="width" val="2"/>
</comp>
<comp lib="0" loc="(1100,240)" name="Pin">
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<a name="facing" val="west"/>
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<a name="output" val="true"/>
</comp>
<comp lib="0" loc="(1100,270)" name="Pin">
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<a name="output" val="true"/>
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<a name="label" val="SEL_R_SRC1"/>
<a name="output" val="true"/>
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</comp>
<comp lib="0" loc="(1100,330)" name="Pin">
<a name="appearance" val="NewPins"/>
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<a name="label" val="SEL_R_SRC2"/>
<a name="output" val="true"/>
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<comp lib="0" loc="(1100,360)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="label" val="SEL_R_DST"/>
<a name="output" val="true"/>
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</comp>
<comp lib="0" loc="(1100,390)" name="Pin">
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<a name="label" val="BRANCH"/>
<a name="output" val="true"/>
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<comp lib="0" loc="(130,560)" name="Clock">
<a name="label" val="CLK"/>
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<comp lib="0" loc="(230,80)" name="Constant">
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<a name="appear" val="center"/>
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<a name="bit8" val="3"/>
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<comp lib="0" loc="(990,590)" name="Constant">
<a name="value" val="0x0"/>
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<comp lib="1" loc="(1010,450)" name="AND Gate">
<a name="size" val="30"/>
<a name="width" val="4"/>
</comp>
<comp lib="1" loc="(1010,500)" name="OR Gate">
<a name="size" val="30"/>
<a name="width" val="4"/>
</comp>
<comp lib="1" loc="(1010,550)" name="XOR Gate">
<a name="size" val="30"/>
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<comp lib="1" loc="(540,670)" name="NOT Gate">
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<comp lib="2" loc="(1110,530)" name="Multiplexer">
<a name="enable" val="false"/>
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<a name="selloc" val="tr"/>
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</comp>
<comp lib="2" loc="(550,700)" name="Decoder">
<a name="select" val="2"/>
<a name="selloc" val="tr"/>
</comp>
<comp lib="2" loc="(740,100)" name="Multiplexer">
<a name="enable" val="false"/>
<a name="width" val="4"/>
</comp>
<comp lib="2" loc="(820,440)" name="Multiplexer">
<a name="enable" val="false"/>
<a name="select" val="2"/>
<a name="selloc" val="tr"/>
<a name="width" val="4"/>
</comp>
<comp lib="2" loc="(820,640)" name="Multiplexer">
<a name="enable" val="false"/>
<a name="select" val="2"/>
<a name="selloc" val="tr"/>
<a name="width" val="4"/>
</comp>
<comp lib="2" loc="(900,630)" name="Multiplexer">
<a name="enable" val="false"/>
<a name="selloc" val="tr"/>
<a name="width" val="4"/>
</comp>
<comp lib="3" loc="(1020,620)" name="Adder">
<a name="width" val="4"/>
</comp>
<comp lib="3" loc="(290,90)" name="Adder">
<a name="width" val="4"/>
</comp>
<comp lib="3" loc="(670,140)" name="Adder">
<a name="width" val="4"/>
</comp>
<comp lib="4" loc="(150,210)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="PC"/>
<a name="width" val="4"/>
</comp>
<comp lib="4" loc="(270,230)" name="ROM">
<a name="addrWidth" val="4"/>
<a name="appearance" val="classic"/>
<a name="contents">addr/data: 4 14
2018 9*0 2078
</a>
<a name="dataWidth" val="14"/>
<a name="label" val="INSTRUCTION_MEMORY"/>
<a name="labelvisible" val="true"/>
</comp>
<comp lib="4" loc="(640,490)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="REG0"/>
<a name="width" val="4"/>
</comp>
<comp lib="4" loc="(640,620)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="REG1"/>
<a name="width" val="4"/>
</comp>
<comp lib="4" loc="(640,750)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="REG2"/>
<a name="width" val="4"/>
</comp>
<comp lib="4" loc="(640,880)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="REG3"/>
<a name="width" val="4"/>
</comp>
<comp lib="5" loc="(130,590)" name="Button">
<a name="label" val="Reset"/>
</comp>
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<wire from="(1010,450)" to="(1040,450)"/>
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